제품 소개팔 발달 널

높은 포트 데이터 비율 TMS320C6748-DEV 발달 널 팔, 디지털 방식으로 DSP LSI 회로 묻힌 팔 널

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중국 N&S ELECTRONIC CO., LIMITED 인증
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큰 이미지 :  높은 포트 데이터 비율 TMS320C6748-DEV 발달 널 팔, 디지털 방식으로 DSP LSI 회로 묻힌 팔 널

제품 상세 정보:
인증: CE
모델 번호: TMS320C6748-DEV
결제 및 배송 조건:
최소 주문 수량: 1PCS
배달 시간: 1-2days
지불 조건: T/T, 서부 동맹, D/P, D/A, L/C
공급 능력: 10000PCS

높은 포트 데이터 비율 TMS320C6748-DEV 발달 널 팔, 디지털 방식으로 DSP LSI 회로 묻힌 팔 널

설명
P/N: TMS320C6748-DEV 유형: 발달 널
하이 라이트:

마이크로 제어기 발달 널

,

발달 널 팔

TMS320C6748-DEV 발달 널, 디지털 방식으로 DSP LSI 회로판

 

 

상세한 제품 설명

 

 

 

 

TMS320C40: 고성능 부동 소수점 디지털 신호 처리기 (DSP)

– ‘320C40-60: 33 ns 명령 주기 시간, 330대의 MOPS, 60 MFLOPS, 30 MIPS, 384M 바이트/s

– ‘320C40-50: 40 ns 명령 주기 시간

– ‘320C40-40: 50 ns 명령 주기 시간

6개의 통신 포트


6 수로 직접 기억 장치 접근 (DMA) Coprocessor

IEEE-754 부동 소수점 체재 에서부터/로 - 주기 변환을 골라내십시오

주기, 1/x, 1/SQRT (x)를 골라내십시오

근원 - TMS320C3x로 양립한 암호로 하십시오

골라내십시오 - 부동 소수점 40 조금, 32 비트 정수 승수를 순환하십시오

12개 40 조금 기록기, 8개의 보조 기록기, 14의 제어 레지스터 및 2개의 타이머

양립한 IEEE 1149.1 (JTAG) 경계 검사

단 하나 공동 메모리 시스템 및 높은 자료 비율을 지원하는 2개의 동일한 외부 데이터와 주소 버스 - 주기 이동:

– 120M Bytes/s (‘C40-60)의 높은 항구 자료 비율 (각 버스)

– 16G 바이트 연속 프로그램 자료/주변 주소 공간

– 빠른, 지적인 버스 중재를 위한 기억 접근 요구

– 분리되는 주소 버스, 자료 버스는, 핀을 통제 가능하게 합니다

– 기억 통제 신호 지원 기계설비에 있는 다른 속도 기억의 4 세트

325 - Pin 세라믹 격자 배열 (GF 접미어)

텍사스 인스투르먼트 (TI)의 0.72-μm 강화된 성과에 의하여 이식되는 CMOS (EPIC) 기술을 사용하는 날조하는

소프트웨어 커뮤니케이션 항구 리셋

중앙 처리 장치 (CPU) 지탱된 성과를 확대하는 프로그램과 데이타 처리량의 다량 동시 입출력 (I/O)의 지원의 분리되는 내부 프로그램, 데이터 및 DMA Coprocessor 버스

에 - 증가된 기억을 위한 칩 프로그램 시렁 및 이중 접근/단 하나 주기 렘 - 성과에 접근하십시오

– 512 바이트 지시 시렁

– 단 하나의 8K 바이트 - 주기 이중 접근 프로그램 또는 자료 렘

– 8, 16-, 또는 32 비트를 사용하는 롬 근거한 부트 로더 지원 프로그램 Bootup

통신 포트의 기억 또는 한

IDLE2 시계 - 힘 아래로 형태를 멈추십시오

5-V 가동

 

우리의 Serices:

 

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모든 부속은 국제적인 고명한 제조자에서 본래 입니다.

 

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모든 선적은 준비합니다 납품에게에 일 수 있습니다 또는 확인한 납품일의 앞에, 고객은 당신의 자신의 운송업자에 의하여 픽업합니다 배열할 수 있습니다,

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연락처 세부 사항
N&S ELECTRONIC CO., LIMITED

담당자: savvy,ren

전화 번호: +8613302928193

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